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        <center>
General Purpose and System Registers
</center>

<span id="more"></span>

<hr>
<p>核心寄存器（Core Register）分为两类：通用寄存器（GPRs）和核心特殊功能寄存器（Core Special Function Registers, CSFRs）。</p>
<p>GPRs包括16个通用数据寄存器和16个通用地址寄存器。<br>CSFRs用于控制核心操作并提供核心状态信息。</p>
<p>寄存器分类</p>
<ul>
<li>通用寄存器（General Purpose Registers）</li>
<li>系统寄存器（System Registers）：PSW, PC, PCXI</li>
<li>栈管理寄存器（Stack Management Registers）：A[10] 和 ISP</li>
<li>SYSCON 和 CPU_ID 寄存器</li>
<li>异常处理寄存器（Trap Registers）</li>
<li>上下文管理寄存器（Context Management Registers）</li>
<li>内存保护寄存器（Memory Protection Registers）</li>
<li>内存管理寄存器（Memory Management Registers）</li>
<li>调试寄存器（Debug Registers）</li>
<li>浮点寄存器（Floating Point Registers）</li>
<li>与核心相关的特殊功能寄存器（Special Function Registers associated with the core）</li>
</ul>
<p><strong>ENDINIT 保护（ENDINIT Protection）</strong><br>该架构支持初始化状态（initialisation state），在进入运行状态（operational state）之前，可以对所有核心特殊功能寄存器（CSFRs）进行修改。<br>在初始化状态时，所有 CSFRs 可以 通过 MTCR 指令 修改。在运行状态下，只有部分 CSFRs 可被修改，其他功能保持不变。</p>
<p>仅可在初始化状态下修改的 CSFRs 被称为“ENDINIT 保护寄存器（ENDINIT protected）。</p>
<p>初始化状态与运行状态的转换由系统实现决定，这种机制增加了对关键 CSFRs的保护，确保它们只能在初始化状态下修改。</p>
<p>以下寄存器受 ENDINIT 保护：BTV, BIV, ISP, PMA0, PMA1, PMA2, PCON0, DCON0, SEGEN</p>
<p>架构还提供了面向安全的 ENDINIT 保护，以下寄存器属于 SAFETY_ENDINIT 保护范围：SMACON, SYSCON, COMPAT, TPS_EXTIM_ENTRY_LVAL, TPS_EXTIM_EXIT_LVAL</p>
<h2 id="1-通用寄存器（General-Purpose-Registers，GPRs）"><a href="#1-通用寄存器（General-Purpose-Registers，GPRs）" class="headerlink" title="1 通用寄存器（General Purpose Registers，GPRs）"></a>1 通用寄存器（General Purpose Registers，GPRs）</h2><p>通用寄存器（GPRs）均分为两类：</p>
<ul>
<li>16个数据寄存器（DGPRs）：D[0] 到 D[15]</li>
<li>16个地址寄存器（AGPRs）：A[0] 到 A[15]</li>
</ul>
<p>数据寄存器和地址寄存器的分离有助于提高处理效率，使算术运算和内存操作可以并行执行。 多个指令支持数据寄存器与地址寄存器之间的信息交换，例如用于创建或计算表索引。</p>
<p>两个连续的偶-奇数据寄存器可以拼接形成八个扩展大小寄存器， 以支持 64 位数据：E[0], E[2], E[4], E[6], E[8], E[10], E[12], E[14]（用于支持 64 位数据）<br>地址寄存器也可以同样拼接：P[0], P[2], P[4], P[6], P[8], P[10], P[12], P[14]</p>
<p><strong>特殊寄存器:</strong></p>
<ul>
<li>系统全局寄存器：A[0], A[1], A[8], A[9]（这些寄存器的内容在调用、异常或中断时不会被保存或恢复）</li>
<li>栈指针（Stack Pointer，SP）：A[10]（参见“栈管理寄存器”）</li>
<li>返回地址（Return Address，RA）：A[11]（用于存储调用和链接跳转的返回地址，以及中断和异常的返回程序计数器 PC）</li>
</ul>
<p>指令对寄存器的使用:</p>
<ul>
<li>32位指令可以无限制地使用GPRs。</li>
<li>许多16位指令会隐式使用 A[15] 作为地址寄存器，D[15] 作为数据寄存器，这种隐式使用有助于将指令编码压缩至16位。</li>
</ul>
<p>浮点运算:没有单独的浮点寄存器，数据寄存器用于执行浮点运算。浮点数据可通过快速上下文切换自动保存和恢复。</p>
<h2 id="2-程序状态信息寄存器（Program-State-Information-Registers）"><a href="#2-程序状态信息寄存器（Program-State-Information-Registers）" class="headerlink" title="2 程序状态信息寄存器（Program State Information Registers）"></a>2 程序状态信息寄存器（Program State Information Registers）</h2><p>程序状态信息寄存器用于存储和恢复任务的上下文，包括：</p>
<ul>
<li>PC（程序计数器）：存储当前执行指令的地址，仅在核心停止时可写入。</li>
<li>PSW（程序状态字）：记录任务的架构状态，包括保护机制、访问权限、调用深度等。</li>
<li>PCXI（先前上下文信息）：用于任务切换时保存上一个任务的状态。</li>
</ul>
<h3 id="2-1-程序计数器（PC）"><a href="#2-1-程序计数器（PC）" class="headerlink" title="2.1 程序计数器（PC）"></a>2.1 程序计数器（PC）</h3><p>32 位，存储当前执行的指令地址。只能在核心暂停状态下修改，否则不会生效。</p>
<h3 id="2-2-程序状态字寄存器（PSW）"><a href="#2-2-程序状态字寄存器（PSW）" class="headerlink" title="2.2 程序状态字寄存器（PSW）"></a>2.2 程序状态字寄存器（PSW）</h3><p>程序状态字寄存器（PSW）是一个32位寄存器，它存储了任务特定的架构状态，这些状态信息不会包含在通用寄存器（GPRs）中。 PSW包括以下参数：</p>
<ul>
<li><p>USB：程序状态字（PSW）的最高8位被定义为用户状态位（User Status Bits）。这些位可在执行指令时被设置或清除，通常用于记录运算结果的状态。 此外，某些指令可以使用这些位来影响其执行逻辑。例如：</p>
<ul>
<li>ADDX（扩展加法）和ADDC（带进位加法）指令使用第31位来记录加法运算中的进位信息。</li>
<li>ADDC 指令在执行时，会读取该进位位的先前值，并将其影响到新的计算结果。</li>
</ul>
</li>
<li><p>保护寄存器集合（PRS）：选择当前活动的数据与代码内存保护寄存器集。内存保护寄存器值控制当前进程内的加载、存储和指令获取。</p>
</li>
<li><p>安全任务标识符（Safety Task Identifier）：用于区分安全任务和普通任务。该标识符可以决定在内部总线上使用哪种 MASTER TAG ID，从而影响读&#x2F;写访问权限。</p>
</li>
<li><p>I&#x2F;O 特权级别（IO）：I&#x2F;O特权级别控制</p>
<ul>
<li>00b：User-0模式，禁止访问外设空间（触发PSE&#x2F;MPP陷阱），无权启用&#x2F;禁用中断</li>
<li>01b：User-1模式，允许访问非保护外设（串行I&#x2F;O端口、定时器等），可禁用中断（默认行为可通过系统控制寄存器覆盖）</li>
<li>10b：监管模式（Supervisor），允许访问所有外设和核心寄存器，可禁用中断</li>
<li>11b：保留值</li>
</ul>
</li>
<li><p>中断栈标志（IS）：中断栈控制</p>
<ul>
<li>0：用户栈，中断触发时从ISP寄存器加载栈指针</li>
<li>1：共享全局栈，中断触发时直接使用当前栈指针</li>
</ul>
</li>
<li><p>全局寄存器写入权限（GW）：该字段决定当前执行线程是否有权限修改全局地址寄存器。大多数任务和中断服务程序（ISR）将全局地址寄存器视为只读寄存器，用于指向全局字面量池和关键数据结构。但是，某些任务或 ISR 可以被指定为特定全局地址寄存器的“所有者”，并且允许修改该寄存器。系统设计者必须决定哪些全局地址变量在高频访问或关键代码中足够重要，以便将它们分配到全局地址寄存器。（A[0]通常被保留为短格式加载和存储的基址寄存器。A[1]也被保留给编译器使用。A[8] 和 A[9]编译器不会使用这两个寄存器，它们可以用于存储关键系统地址变量。）</p>
<ul>
<li>1 ：允许希望全局地址寄存器 A[0], A[1], A[8], A[9]</li>
<li>0 ：禁止希望全局地址寄存器 A[0], A[1], A[8], A[9]</li>
</ul>
</li>
<li><p>调用深度计数器（CDC）：调用深度计数使能</p>
<ul>
<li>0：临时禁用计数，执行下一条CALL指令后自动启用。（关闭后，第一次 CALL 不会增加 CDC，但不会永久禁用，只是暂时忽略当前调用。下一次 CALL 指令会自动恢复 CDC 计数，确保后续函数调用正确记录深度）</li>
<li>1：启用计数，若CDC&#x3D;1111111b则强制禁用计数</li>
</ul>
</li>
<li><p>调用深度计数启用字段（CDE）：调用深度计数器，CALL指令递增，RETURN指令递减，计数溢出时触发CDO陷阱。<br>特殊模式：</p>
<ul>
<li>1111110b：每次CALL触发陷阱（调用跟踪模式）</li>
<li>1111111b：禁用调用深度计数</li>
</ul>
</li>
</ul>
<p><strong>访问特权级别控制（I&#x2F;O Privilege）</strong><br>软件管理任务（SMT，Software Managed Tasks），通过实时内核（RTOS）或操作系统创建，由调度软件进行任务调度。中断服务程序（ISR，Interrupt Service Routine）由硬件直接触发，处理外部或内部中断。<br>SMT 有时被称为“用户任务”（User Tasks），默认在用户模式（User Mode）下执行。<br>任务模式分类：每个任务根据其功能被分配不同的运行模式</p>
<ul>
<li>User-0 模式：适用于不需要访问外围设备的任务。无法启用或禁用中断。</li>
<li>User-1 模式：适用于访问常规、未受保护的外设的任务，例如：串行端口的读写，定时器的读取，大多数 I&#x2F;O 状态寄存器。允许任务禁用中断（但其默认行为可由系统控制寄存器修改）。</li>
<li>Supervisor 模式：允许访问所有系统寄存器和外设。任务可以启用或禁用中断。</li>
</ul>
<p><strong>任务上下文（Task Context）</strong><br>每个任务都有一组状态元素，统称为任务上下文，任务上下文包括：</p>
<ul>
<li>CPU 通用寄存器（General Purpose Registers）</li>
<li>程序计数器（PC，Program Counter）</li>
<li>程序状态信息（PCXI 和 PSW）</li>
</ul>
<p>这些信息是处理器定义任务状态并保持任务执行所需的关键数据。</p>
<h3 id="2-3-先前上下文信息和指针寄存器（Previous-Context-Information-and-Pointer-Register，PCXI）"><a href="#2-3-先前上下文信息和指针寄存器（Previous-Context-Information-and-Pointer-Register，PCXI）" class="headerlink" title="2.3 先前上下文信息和指针寄存器（Previous Context Information and Pointer Register，PCXI）"></a>2.3 先前上下文信息和指针寄存器（Previous Context Information and Pointer Register，PCXI）</h3><p>先前上下文信息寄存器（PCXI）存储与先前执行上下文相关的链接信息，用于支持中断和自动上下文切换。该寄存器是任务状态信息的一部分，其中先前上下文指针（PCX） 保存前一个任务的上下文保存区（CSA）的地址。</p>
<p>PCXI 寄存器字段包含这些字段：</p>
<ul>
<li>PCPN（存储被中断任务的优先级级别）</li>
<li>PIE（存储被中断任务的中断使能位（ICR.IE）的状态。）</li>
<li>UL（标识保存的上下文类型：上层或下层）<ul>
<li>0：下层上下文（Lower Context）</li>
<li>1：上层上下文（Upper Context）</li>
</ul>
</li>
<li>PCXS：存储PCX 段地址，该字段与 PCXO（先前上下文指针偏移） 结合使用。</li>
<li>PCXO（先前上下文指针偏移字段）</li>
</ul>
<p>PCXO 和 PCXS 共同形成 PCX 指针，用于指向先前任务的 CSA（上下文保存区）。</p>
<p>PCXI 寄存器用于维护任务的上下文信息，特别是在任务切换、异常处理和中断处理时。它确保处理器可以正确恢复先前任务的运行状态，避免错误的上下文切换导致系统故障。</p>
<h2 id="3-堆栈管理寄存器（Stack-Management-Registers）"><a href="#3-堆栈管理寄存器（Stack-Management-Registers）" class="headerlink" title="3 堆栈管理寄存器（Stack Management Registers）"></a>3 堆栈管理寄存器（Stack Management Registers）</h2><p>tricore架构的堆栈管理支持用户堆栈和中断堆栈，并使用地址寄存器 A[10]、中断堆栈指针（ISP）以及 PSW 寄存器中的一个位来管理堆栈。</p>
<p>A[10] 作为堆栈指针（Stack Pointer，SP）使用。当一个任务被创建时，实时操作系统（RTOS）通常会初始化该寄存器的内容，以便为任务分配私有堆栈区域。</p>
<p>ISP 的作用是防止中断服务程序（ISR） 访问任务的私有堆栈，避免影响任务的上下文。</p>
<p>中断时的堆栈切换:</p>
<ul>
<li>如果被中断的任务使用的是私有堆栈（PSW.IS &#x3D;&#x3D; 0）：任务的上层上下文被保存。A[10]（SP）被加载为当前 ISP 的值。</li>
<li>如果被中断的任务已经在使用中断堆栈（PSW.IS &#x3D;&#x3D; 1）：A[10]（SP）不会重新加载，ISR 继续使用中断堆栈，而不会切换到新的栈指针。</li>
</ul>
<p>通常在系统初始化时，只需要初始化 ISP 一次。</p>
<p>在某些应用场景下，ISP 可能会在执行过程中动态修改。架构并未禁止 ISR 或系统服务程序使用私有堆栈，是否使用取决于系统的设计。</p>
<h2 id="4-系统控制寄存器（SYSCON）"><a href="#4-系统控制寄存器（SYSCON）" class="headerlink" title="4 系统控制寄存器（SYSCON）"></a>4 系统控制寄存器（SYSCON）</h2><p>系统配置寄存器 SYSCON 提供以下功能：</p>
<ul>
<li><p>用于 时序保护系统（Temporal Protection System） 的使能位。</p>
</li>
<li><p>用于 内存保护系统（Memory Protection System） 的使能位：在将使能位设为 1 之前，必须先初始化保护寄存器组。</p>
</li>
<li><p>用于定义 中断处理程序（Interrupt Handlers） 中 PSW.S 位的初始状态的位。</p>
</li>
<li><p>用于定义 陷阱处理程序（Trap Handlers） 中 PSW.S 位的初始状态的位。</p>
</li>
<li><p>User-1 IO 模式外设访问的使能位：允许 User-1 模式任务 像 Supervisor 模式 一样访问外设，使 User-1 模式 能够访问 所有外设寄存器。</p>
</li>
<li><p>User-1 IO 模式中断使能&#x2F;禁用能力的禁用位：禁止 在 User-1 IO 模式下执行 User-1 指令（包含中断使能&#x2F;关闭指令）。</p>
</li>
<li><p>启动暂停状态（Boot Halt Status） 和 启动释放（Release Bit）:在复位后，CPU 可能会被立即置于暂停状态，此时 BHALT 位 被设为 1。CPU 将保持暂停状态，直到该位被写入 0。当 BHALT 从 1 写入 0 时，CPU 将开始执行，起始地址由 程序计数器（PC）寄存器 定义。如果尝试将该位写入 1，则该写入将被忽略。</p>
</li>
<li><p>空闲上下文列表耗尽（Free Context List Depletion Condition， FCDSF） 状态指示器：该粘滞位表示 自上次软件清除该位以来，是否发生了 FCD（空闲上下文列表耗尽）陷阱。</p>
</li>
</ul>
<p>注意：<strong>此寄存器受 SAFETY_ENDINIT 保护，但 FCDSF 位除外</strong>。</p>
<h2 id="5-中断寄存器（Interrupt-Registers）"><a href="#5-中断寄存器（Interrupt-Registers）" class="headerlink" title="5 中断寄存器（Interrupt Registers）"></a>5 中断寄存器（Interrupt Registers）</h2><p>在 TriCore 架构 中，典型的 服务请求控制寄存器（Service Request Control Register） 包含以下控制位：</p>
<ul>
<li>启用或禁用中断请求</li>
<li>分配中断的优先级</li>
<li>将中断请求指向特定的服务提供者</li>
</ul>
<p>核心特殊功能寄存器（CSFR） 负责控制中断功能，详细信息见“中断系统”</p>
<h2 id="6-内存保护寄存器（Memory-Protection-Registers）"><a href="#6-内存保护寄存器（Memory-Protection-Registers）" class="headerlink" title="6 内存保护寄存器（Memory Protection Registers）"></a>6 内存保护寄存器（Memory Protection Registers）</h2><p>每个架构实现的内存保护寄存器组数量不同，最多可支持 8 组。</p>
<p>每组包括 数据集（Data Set）和代码集（Code Set）。</p>
<p>每个寄存器组由多个 范围寄存器（Range Table Entries） 组成：</p>
<p>每个 范围表项 包含一个段保护寄存器对和一个模式寄存器的位字段，寄存器对用于定义内存范围的上下边界地址。</p>
<p>核心特殊功能寄存器（CSFR） 负责控制 内存保护寄存器，详细信息见“内存保护系统”。</p>
<h2 id="7-陷阱寄存器（Trap-Registers）"><a href="#7-陷阱寄存器（Trap-Registers）" class="headerlink" title="7 陷阱寄存器（Trap Registers）"></a>7 陷阱寄存器（Trap Registers）</h2><p>核心特殊功能寄存器（CSFR） 负责控制 陷阱寄存器，详细信息见“陷阱系统”。</p>
<h2 id="8-核心调试控制器寄存器（Core-Debug-Controller-Registers）"><a href="#8-核心调试控制器寄存器（Core-Debug-Controller-Registers）" class="headerlink" title="8 核心调试控制器寄存器（Core Debug Controller Registers）"></a>8 核心调试控制器寄存器（Core Debug Controller Registers）</h2><p>TriCore 处理器中的调试支持寄存器 详细信息见“核心调试控制器”</p>
<h2 id="9-浮点寄存器（Floating-Point-Registers）"><a href="#9-浮点寄存器（Floating-Point-Registers）" class="headerlink" title="9 浮点寄存器（Floating Point Registers）"></a>9 浮点寄存器（Floating Point Registers）</h2><p>TriCore 处理器可选的浮点运算单元（FPU）寄存器 详细信息见“FPU_TRAP_CON”。</p>
<h2 id="10-访问核心特殊功能寄存器（CSFRs）"><a href="#10-访问核心特殊功能寄存器（CSFRs）" class="headerlink" title="10 访问核心特殊功能寄存器（CSFRs）"></a>10 访问核心特殊功能寄存器（CSFRs）</h2><p>核心特殊功能寄存器（CSFR） 通过以下指令访问：</p>
<ul>
<li>MFCR（Move From Core Register） → 读取 CSFR。</li>
<li>MTCR（Move To Core Register） → 写入 CSFR。</li>
</ul>
<p>软件通常不需要频繁更新 CSFR。因此</p>
<ul>
<li>硬件实现不需要特殊结构来避免 CSFR 更新的竞争风险。</li>
<li>软件实现中，在 MTCR 更新 CSFR 后，需插入 ISYNC 指令，确保 CSFR 更新的影响正确被后续指令识别。</li>
</ul>
<p>其他访问规则：</p>
<ul>
<li>MTCR 访问未定义寄存器时，不会产生任何影响。</li>
<li>MFCR 访问未定义寄存器时，将返回未定义数据。</li>
</ul>

    </div>

    
    
    

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      <strong>本文作者： </strong>feng xun
  </li>
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      <strong>本文链接：</strong>
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  </li>
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    <strong>版权声明： </strong>本博客所有文章除特别声明外，均采用 <a href="https://creativecommons.org/licenses/by-nc-sa/4.0/deed.zh" rel="noopener" target="_blank"><i class="fab fa-fw fa-creative-commons"></i>BY-NC-SA</a> 许可协议。转载请注明出处！
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